AMD Ryzen 9 9950X3D2 & 9850X3D sollen an den Start gehen
AMD soll sein Portfolio an Gaming-CPUs mit 3D V-Cache um das neue Spitzenmodell, den Ryzen 9 9950X3D2 mit insgesamt zwei X3D-Chiplets, sowie einen noch schnelleren Octa-Core-Prozessor, den Ryzen 7 9850X3D, erweitern.
Die Gerüchte über weitere Gaming-CPUs mit 3D V-Cache halten sich bereits seit Längerem, jetzt möchte chi11eddog erfahren haben, dass AMD sein Portfolio um das neue Spitzenmodell, den Ryzen 9 9950X3D2 mit zwei X3D-Chiplets und insgesamt 192 MiByte L3-Cache, sowie einen nochmals schnelleren Octa-Core-Prozessor, den Ryzen 7 9850X3D, erweitern und damit die Zeit bis zu Zen 6 überbrücken wird.
Quelle: chi11eddog
Während der AMD Ryzen 9 9950X3D2 im Grunde einem Ryzen 9 9950X3D mit zweimal 64 MiByte 3D V-Cache und 100 MHz weniger Taktfrequenz entsprechen soll, handelt es sich beim Ryzen 7 9850X3D demnach um einen Ryzen 7 9800X3D mit entsprechend 400 MHz mehr Boosttakt. Während die TDP beim kommenden Spitzenmodell auf 200 Watt steigt, bleibt bei Octa-Core alles wie gehabt.
| Prozessorkerne | Taktfrequenz | L2-Cache (3D V-Cache) | TDP | |
|---|---|---|---|---|
| AMD Ryzen 9 9950X3D2 | 16 × Zen 5 | Bis zu 5,6 GHz | 192 MiByte (128 MiByte) | 200 Watt |
| AMD Ryzen 9 9950X3D | 16 × Zen 5 | Bis zu 5,7 GHz | 128 MiByte (64 MiByte) | 170 Watt |
| AMD Ryzen 9 9900X3D | 12 × Zen 5 | Bis zu 5,5 GHz | 128 MiByte (64 MiByte) | 120 Watt |
| AMD Ryzen 7 9850X3D | 8 × Zen 5 | Bis zu 5,6 GHz | 96 MiByte (64 MiByte) | 120 Watt |
| AMD Ryzen 7 9800X3D | 8 × Zen 5 | Bis zu 5,2 GHz | 96 MiByte (64 MiByte) | 120 Watt |
Ob die beiden neuen Gaming-CPUs aber tatsächlich so erscheinen werden, muss vorerst abgewartet werden. Gerüchte um eine Version mit Dual-X3D-Chiplet halten sich seit längerer Zeit in den Schlagzeilen und haben sich bislang nie bestätigt.
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Quelle: chi11eddog via VideoCardz
Nein, man bringt einfach Zusatzcache für jedes CCD, genial.
Es könnte wirklich sein, dass man dann komplett ohne CPPC und Treiber-Optimierungen besser fährt.
Meinst du L1 und L2?
Der 3D V-Cache ist ja L3 auf den alle Kerne im CCD zugreifen können.
Die L1 und L2 Cachestufen sind jeweils pro Kern vorhanden.